Changes between Version 19 and Version 20 of MjpegCourse/Monopro


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Timestamp:
Mar 11, 2009, 11:39:05 AM (15 years ago)
Author:
Nicolas Pouillon
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  • MjpegCourse/Monopro

    v19 v20  
    4646 * Elle comporte un processeur et son cache, deux contrôleurs mémoire RAM0 et RAM1, et un contrôleur de terminal TTY.
    4747
    48 '''Attention''': les deux coprocesseurs matériels d'entrée/sortie TG et RAMDAC, ne doivent
    49 pas être décrits dans l'architecture !VgmnNoirqMono. Ces deux coprocesseurs, ainsi que
    50 les deux contrôleurs MWMR leur permettant d'accéder aux canaux MWMR ne sont utilisés
     48'''Attention''': les deux coprocesseurs matériels d'entrée/sortie TG et RAMDAC, doivent
     49être décrits dans l'architecture !VgmnNoirqMono.
     50
     51Ces deux coprocesseurs, ainsi que les deux contrôleurs MWMR leur permettant d'accéder aux canaux MWMR ne sont utilisés
    5152que par l'application MJPEG, et pas par l'application !SplitMsg. Ils  seront
    52 automatiquement générés dans la phase de "déploiement" de l'application MJPEG,
    53 lorsqu'on précisera que les tâches `tg` et `ramdac` du TCG sont implémentés comme des
    54 composants matériels.
     53donc inutiles pour !SplitMsg.
    5554
    5655Commencez par créer un répertoire de travail TP2.
     
    234233     assignés à une adresse. Un déploiement valide pour `tg` est par exemple:
    235234{{{
    236 mapper.map( 'tg0',
    237             vci = 'vgmn0',
    238             address = 0x94000000 )
    239 }}}
    240    * De même déployez `ramdac` sur la plateforme (à une autre adresse).
     235m.map('tg',
     236          coprocessor = 'tg0',
     237          controller = 'tg0_ctrl'
     238          )
     239}}}
     240   * De même déployez `ramdac` sur la plateforme.
    241241 * Relancez la description, recompilez, lancez la simulation.
    242242{{{