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v144 v145 25 25 || 41|| C4|| [htdocs:cours/ALMO-2019-4.pdf Bus système et périphériques / GIET] ||TD4[[BR]]TP4|| [[SujetTD4|Bus système et périphériques]][[BR]][[SujetTP4|Exécution de code sur architecture mono-processeur]] || Assemb || 26 26 || 42|| C5|| [htdocs:cours/ALMO-2019-5_Cache.pdf Hiérarchie mémoire et techniques de cache] ||TD5[[BR]]TP5|| [[SujetTD5|Principe des mémoires caches]][[BR]][[SujetTP5|Effets de cache]] |||| 27 || 43|| C6|| [htdocs:cours/ALMO-2019-6_Cache-suite.pdf Caches (suite) Interrupts, exceptions, trappes] ||TD6[[BR]]TP6|| [[SujetTD6|Influence des caches sur les performances]][[BR]][[SujetTP6|Mémoires cache : mesure de performance]] ||||27 || 43|| C6|| [htdocs:cours/ALMO-2019-6_Cache-suite.pdf Caches (suite)] ||TD6[[BR]]TP6|| [[SujetTD6|Influence des caches sur les performances]][[BR]][[SujetTP6|Mémoires cache : mesure de performance]] |||| 28 28 || 44||||||||||**Vacances de la toussaint** || 29 29 || 45|| C7|| [htdocs:cours/ALMO-2019-7.pdf Accès aux périphériques : ICU, TTY, TIMER] ||TD7[[BR]]TP7|| [[SujetTD7|Analyse GIET]][[BR]][[SujetTP7|Communications par interruptions]] || Cache ||