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v20 v21 9 9 * [wiki:SoclibCourseTp4 TP4 : Architectures multi-processeurs et périphériques] 10 10 * [wiki:SoclibCourseTp5 TP5 : GDB Server & architectures clusterisées] 11 * [wiki:SoclibCourseTp6 TP6 : Modélisation d'un contrôleur de cache L1]12 * [wiki:SoclibCourseTp7 TP7 : Modélisation TLM-DT]11 * [wiki:SoclibCourseTp6 TP6 : Modélisation d'un contrôleur de cache à interface VCI] 12 13 13 14 14 == Annales MPSoC (fichiers .pdf ==