Changes between Version 5 and Version 6 of VLSI2-TP2-2017
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VLSI2-TP2-2017
v5 v6 34 34 '''{{{accu}}}''' et '''{{{adder}}}'''. 35 35 36 [[Image(addaccu-1.png, nolink, center, scale=0.7)]]36 [[Image(addaccu-1.png, 60%, center, nolink)]] 37 37 38 38 Les deux blocs '''{{{mux}}}''' et '''{{{accu}}}''' sont des générateurs paramétrables … … 120 120 121 121 La cellule ''{{{sff1_x4}}}'' est une bascule D à échantillonnage sur front montant. Vous 122 pouvez consulter le modèle comportemental de cette cellule: [attachment:sff1_x4.vbe 123 sff1_x4.vbe]. 122 pouvez consulter le modèle comportemental de cette cellule: [attachment:sff1_x4.vbe sff1_x4.vbe]. 124 123 125 124 … … 136 135 impair. Le bit de ''retenue'' est égal à 1 lorsqu'au moins deux bits d'entrée valent 1. 137 136 138 ||= a =||= b =||= c =||= s =||= r=||137 ||= - a - =||= - b - =||= - c - =||= - s - =||= - r - =|| 139 138 || 0 || 0 || 0 ||= 0 =||= 0 =|| 140 139 || 0 || 0 || 1 ||= 1 =||= 0 =|| … … 295 294 '''{{{Stratus}}}''' propose aussi une bibliothèque d'opérateurs de chemins de données 296 295 (''datapath''). Sa documentation est accessible 297 [file:///soc/coriolis2/share/doc/coriolis2/en/html/ stratus/index.html ici]296 [file:///soc/coriolis2/share/doc/coriolis2/en/html/dpgen/index.html ici] 298 297 299 298 * Ré-écrire un '''{{{addaccu}}}''' paramétrable en utilisant les opérateurs de
