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Introducing the tsar_generic_iob platform.
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2// File: tsar_iob_cluster.h
3// Author: Alain Greiner
4// Copyright: UPMC/LIP6
5// Date : april 2013
6// This program is released under the GNU public license
7//////////////////////////////////////////////////////////////////////////////
8
9#ifndef SOCLIB_CABA_TSAR_IOB_CLUSTER_H
10#define SOCLIB_CABA_TSAR_IOB_CLUSTER_H
11
12#include <systemc>
13#include <sys/time.h>
14#include <iostream>
15#include <sstream>
16#include <cstdlib>
17#include <cstdarg>
18
19#include "gdbserver.h"
20#include "mapping_table.h"
21#include "mips32.h"
22#include "vci_simple_ram.h"
23#include "vci_xicu.h"
24#include "dspin_local_crossbar.h"
25#include "vci_dspin_initiator_wrapper.h"
26#include "vci_dspin_target_wrapper.h"
27#include "dspin_router.h"
28#include "virtual_dspin_router.h"
29#include "vci_multi_dma.h"
30#include "vci_mem_cache.h"
31#include "vci_cc_vcache_wrapper.h"
32#include "vci_io_bridge.h"
33
34namespace soclib { namespace caba       {
35
36///////////////////////////////////////////////////////////////////////////
37template<typename vci_param_int, 
38         typename vci_param_ext,
39         size_t   dspin_int_cmd_width, 
40         size_t   dspin_int_rsp_width,
41         size_t   dspin_ram_cmd_width,
42         size_t   dspin_ram_rsp_width>
43class TsarIobCluster
44///////////////////////////////////////////////////////////////////////////
45    : public soclib::caba::BaseModule
46{
47
48  public:
49
50        // Ports
51    sc_in<bool>                                            p_clk;
52    sc_in<bool>                                            p_resetn;
53
54    soclib::caba::VciInitiator<vci_param_ext>*         p_vci_iox_ini;
55    soclib::caba::VciTarget<vci_param_ext>*            p_vci_iox_tgt;
56
57    sc_in<bool>*                                       p_irq[32];  // not always used
58
59        soclib::caba::DspinOutput<dspin_int_cmd_width>**   p_dspin_int_cmd_out;
60        soclib::caba::DspinInput<dspin_int_cmd_width>**    p_dspin_int_cmd_in;
61    soclib::caba::DspinOutput<dspin_int_rsp_width>**   p_dspin_int_rsp_out;
62    soclib::caba::DspinInput<dspin_int_rsp_width>**    p_dspin_int_rsp_in;
63
64        soclib::caba::DspinOutput<dspin_ram_cmd_width>*    p_dspin_ram_cmd_out;
65        soclib::caba::DspinInput<dspin_ram_cmd_width>*     p_dspin_ram_cmd_in;
66    soclib::caba::DspinOutput<dspin_ram_rsp_width>*    p_dspin_ram_rsp_out;
67    soclib::caba::DspinInput<dspin_ram_rsp_width>*     p_dspin_ram_rsp_in;
68
69    // interrupt signals
70        sc_signal<bool>                       signal_false;
71        sc_signal<bool>                               signal_proc_it[8];
72        sc_signal<bool>                               signal_irq_mdma[8];
73       
74        // INT network DSPIN signals between DSPIN routers and DSPIN local_crossbars
75        DspinSignals<dspin_int_cmd_width>     signal_int_dspin_cmd_l2g_d; 
76        DspinSignals<dspin_int_cmd_width>     signal_int_dspin_cmd_g2l_d; 
77        DspinSignals<dspin_int_cmd_width>     signal_int_dspin_m2p_l2g_c;
78        DspinSignals<dspin_int_cmd_width>     signal_int_dspin_m2p_g2l_c; 
79        DspinSignals<dspin_int_rsp_width>     signal_int_dspin_rsp_l2g_d; 
80        DspinSignals<dspin_int_rsp_width>     signal_int_dspin_rsp_g2l_d; 
81        DspinSignals<dspin_int_rsp_width>     signal_int_dspin_p2m_l2g_c;
82        DspinSignals<dspin_int_rsp_width>     signal_int_dspin_p2m_g2l_c;
83
84        // INT network VCI signals between VCI components and VCI/DSPIN wrappers
85        VciSignals<vci_param_int>                 signal_int_vci_ini_proc[8]; 
86        VciSignals<vci_param_int>                 signal_int_vci_ini_mdma; 
87        VciSignals<vci_param_int>                 signal_int_vci_ini_iobx; 
88
89        VciSignals<vci_param_int>                 signal_int_vci_tgt_memc;
90        VciSignals<vci_param_int>                 signal_int_vci_tgt_xicu;
91        VciSignals<vci_param_int>             signal_int_vci_tgt_mdma;
92        VciSignals<vci_param_int>             signal_int_vci_tgt_iobx;
93
94        // INT network DSPIN signals between DSPIN local crossbars and VCI/DSPIN wrappers
95        DspinSignals<dspin_int_cmd_width>     signal_int_dspin_cmd_proc_i[8];
96        DspinSignals<dspin_int_rsp_width>     signal_int_dspin_rsp_proc_i[8];
97        DspinSignals<dspin_int_cmd_width>     signal_int_dspin_cmd_mdma_i;
98        DspinSignals<dspin_int_rsp_width>     signal_int_dspin_rsp_mdma_i;
99        DspinSignals<dspin_int_cmd_width>     signal_int_dspin_cmd_iobx_i;
100        DspinSignals<dspin_int_rsp_width>     signal_int_dspin_rsp_iobx_i;
101
102        DspinSignals<dspin_int_cmd_width>     signal_int_dspin_cmd_memc_t;
103        DspinSignals<dspin_int_rsp_width>     signal_int_dspin_rsp_memc_t;
104        DspinSignals<dspin_int_cmd_width>     signal_int_dspin_cmd_xicu_t;
105        DspinSignals<dspin_int_rsp_width>     signal_int_dspin_rsp_xicu_t;
106        DspinSignals<dspin_int_cmd_width>     signal_int_dspin_cmd_mdma_t;
107        DspinSignals<dspin_int_rsp_width>     signal_int_dspin_rsp_mdma_t;
108        DspinSignals<dspin_int_cmd_width>     signal_int_dspin_cmd_iobx_t;
109        DspinSignals<dspin_int_rsp_width>     signal_int_dspin_rsp_iobx_t;
110
111        // Coherence DSPIN signals between DSPIN local crossbars and CC components
112        DspinSignals<dspin_int_cmd_width>     signal_int_dspin_m2p_memc;
113        DspinSignals<dspin_int_rsp_width>     signal_int_dspin_p2m_memc;
114        DspinSignals<dspin_int_cmd_width>     signal_int_dspin_m2p_proc[8];
115        DspinSignals<dspin_int_rsp_width>     signal_int_dspin_p2m_proc[8];
116
117        // RAM network VCI signals between VCI components and VCI/DSPIN wrappers
118        VciSignals<vci_param_ext>             signal_ram_vci_ini_memc;
119        VciSignals<vci_param_ext>             signal_ram_vci_ini_iobx;
120        VciSignals<vci_param_ext>             signal_ram_vci_tgt_xram;
121
122    // RAM network DSPIN signals between VCI/DSPIN wrappers and crossbars or routers
123        DspinSignals<dspin_ram_cmd_width>     signal_ram_dspin_cmd_xram_t;
124        DspinSignals<dspin_ram_rsp_width>     signal_ram_dspin_rsp_xram_t;
125        DspinSignals<dspin_ram_cmd_width>     signal_ram_dspin_cmd_memc_i;
126        DspinSignals<dspin_ram_rsp_width>     signal_ram_dspin_rsp_memc_i;
127        DspinSignals<dspin_ram_cmd_width>     signal_ram_dspin_cmd_iobx_i;
128        DspinSignals<dspin_ram_rsp_width>     signal_ram_dspin_rsp_iobx_i;
129 
130    // RAM network DSPIN signals between DSPIN routers and DSPIN local crossbars
131        DspinSignals<dspin_ram_cmd_width>     signal_ram_dspin_cmd_l2g; 
132        DspinSignals<dspin_ram_cmd_width>     signal_ram_dspin_cmd_g2l; 
133        DspinSignals<dspin_ram_rsp_width>     signal_ram_dspin_rsp_l2g; 
134        DspinSignals<dspin_ram_rsp_width>     signal_ram_dspin_rsp_g2l; 
135       
136    //////////////////////////////////////
137    // Hardwate Components (pointers)
138    //////////////////////////////////////
139    VciCcVCacheWrapper<vci_param_int, 
140                       dspin_int_cmd_width,
141                       dspin_int_rsp_width,
142                       GdbServer<Mips32ElIss> >*      proc[8];
143
144    VciDspinInitiatorWrapper<vci_param_int,
145                             dspin_int_cmd_width,
146                             dspin_int_rsp_width>*    proc_wi[8];
147
148    VciMemCache<vci_param_int,
149                vci_param_ext, 
150                dspin_int_rsp_width, 
151                dspin_int_cmd_width>*                 memc;
152
153    VciDspinTargetWrapper<vci_param_int,
154                          dspin_int_cmd_width,
155                          dspin_int_rsp_width>*       memc_int_wt;
156
157    VciDspinInitiatorWrapper<vci_param_ext,
158                             dspin_ram_cmd_width,
159                             dspin_ram_rsp_width>*    memc_ram_wi;
160
161    VciXicu<vci_param_int>*                           xicu;
162
163    VciDspinTargetWrapper<vci_param_int,
164                          dspin_int_cmd_width,
165                          dspin_int_rsp_width>*       xicu_int_wt;
166
167    VciMultiDma<vci_param_int>*                       mdma;
168
169    VciDspinInitiatorWrapper<vci_param_int,
170                             dspin_int_cmd_width,
171                             dspin_int_rsp_width>*    mdma_int_wi;
172
173    VciDspinTargetWrapper<vci_param_int,
174                          dspin_int_cmd_width,
175                          dspin_int_rsp_width>*       mdma_int_wt;
176
177    DspinLocalCrossbar<dspin_int_cmd_width>*          int_xbar_cmd_d;
178    DspinLocalCrossbar<dspin_int_rsp_width>*          int_xbar_rsp_d;
179    DspinLocalCrossbar<dspin_int_cmd_width>*          int_xbar_m2p_c;
180    DspinLocalCrossbar<dspin_int_rsp_width>*          int_xbar_p2m_c;
181
182    VirtualDspinRouter<dspin_int_cmd_width>*          int_router_cmd;
183    VirtualDspinRouter<dspin_int_rsp_width>*          int_router_rsp;
184
185    VciSimpleRam<vci_param_ext>*                      xram;
186
187    VciDspinTargetWrapper<vci_param_ext,
188                          dspin_ram_cmd_width,
189                          dspin_ram_rsp_width>*       xram_ram_wt;
190       
191    DspinRouter<dspin_ram_cmd_width>*                 ram_router_cmd;
192    DspinRouter<dspin_ram_rsp_width>*                 ram_router_rsp;
193
194        // IO Network Components (not instanciated in all clusters)
195
196    VciIoBridge<vci_param_int,
197                vci_param_ext>*                       iob;
198
199    VciDspinInitiatorWrapper<vci_param_int,
200                             dspin_int_cmd_width,
201                             dspin_int_rsp_width>*    iob_int_wi;
202
203    VciDspinTargetWrapper<vci_param_int,
204                          dspin_int_cmd_width,
205                          dspin_int_rsp_width>*       iob_int_wt;
206
207    VciDspinInitiatorWrapper<vci_param_ext,
208                             dspin_ram_cmd_width,
209                             dspin_ram_rsp_width>*    iob_ram_wi;
210       
211    DspinLocalCrossbar<dspin_ram_cmd_width>*          ram_xbar_cmd; 
212    DspinLocalCrossbar<dspin_ram_rsp_width>*          ram_xbar_rsp; 
213
214    // cluster constructor
215        TsarIobCluster( sc_module_name                     insname,
216                    size_t                             nb_procs,   
217                    size_t                             nb_dmas, 
218                    size_t                             x,             // x coordinate
219                    size_t                             y,             // y coordinate
220                    size_t                             xmax,
221                    size_t                             ymax,
222
223                    const soclib::common::MappingTable &mt_int,
224                    const soclib::common::MappingTable &mt_ext,
225                    const soclib::common::MappingTable &mt_iox,
226
227                    size_t                                 x_width,       // x field  bits
228                    size_t                                 y_width,       // y field  bits
229                    size_t                                 l_width,       // l field  bits
230
231                    size_t                                 int_memc_tgtid,
232                    size_t                                 int_xicu_tgtid,
233                    size_t                                 int_mdma_tgtid,
234                    size_t                                 int_iobx_tgtid,
235
236                    size_t                             int_proc_srcid,
237                    size_t                             int_mdma_srcid,
238                    size_t                             int_iobx_srcid,
239
240                    size_t                             ext_xram_tgtid,
241
242                    size_t                             ext_memc_srcid,
243                    size_t                             ext_iobx_srcid,
244
245                    size_t                             memc_ways,
246                    size_t                             memc_sets,
247                    size_t                             l1_i_ways,
248                    size_t                             l1_i_sets, 
249                    size_t                             l1_d_ways,
250                    size_t                             l1_d_sets,       
251                    size_t                             xram_latency, 
252
253                    const Loader                       &loader,       // loader for XRAM
254
255                    uint32_t                           frozen_cycles, 
256                    uint32_t                           start_debug_cycle,
257                    bool                               memc_debug_ok, 
258                    bool                               proc_debug_ok, 
259                    bool                               iob0_debug_ok ); 
260
261};
262
263}}
264
265#endif
Note: See TracBrowser for help on using the repository browser.